《普通高等教育“十二五”规划教材·工程创新型电子信息类精品教材:EDA技术及其创新实践(Verilog HDL版)》的教学目标有二,特色有一:掌握EDA技术基础理论及其工程实践基本技能、基于EDA的平台及《普通高等教育“十二五”规划教材·工程创新型电子信息类精品教材:EDA技术及其创新实践(Verilog HDL版)》给出的大量实践项目促进自主创新能力的有效提高;特色是速成。为此,全书做了精心的编排,在第1章中就将EDA技术的总体概况和盘托出,甚至包括EDA技术相关的软硬件基本特点、结构和原理;在第2、第4和第6章中分别介绍了基于Verilog的组合电路设计、时序电路设计,和HDL设计技巧与优化技术的深入;所用的教学方法都是基于流行于国际的以电路模块为先导的情景式教学模型。为能快速进入实践操练阶段,在第3、第5和第7章中分别穿插了EDA软件应用、逻辑仿真、FPGA硬件验证及开发、LPM宏模块应用,以及与工程实践更靠拢的状态机设计技术等内容;使得从第3章开始,读者就有机会不断地将书本知识及时有效地融入实验验证、技能提高和经验积累。在前期知识铺垫的基础上,第8章给出的16位实用CPU设计技

第1章 EDA技术概述
1.1 EDA技术
1.2 EDA技术应用对象
1.3 硬件描述语言Verilog HDL
1.4 EDA技术的优势
1.5 面向FPGA的EDA开发流程
1.6 可编程逻辑器件
1.6.1 PLD的分类
1.6.2 PROM可编程原理
1.6.3 GAL
1.7 CPLD的结构与可编程原理
1.8 FPGA的结构与工作原理
1.8.1 查找表逻辑结构
1.8.2 Cyclone Ⅲ 系列器件的结构原理
1.9 硬件测试技术
1.10 FPGA/CPLD产品概述
1.10.1 Lattice公司的PLD器件
1.10.2 Xilinx公司的PLD器件
1.10.3 Altera公司的PLD器件
1.11 编程与配置
1.12 Quartus Ⅱ
1.13 EDA的发展趋势
思考题
第2章 组合电路Verilog设计
2.1 半加器电路的Verilog描述
2.1.1 半加器的数据流建模描述方式
2.1.2 半加器的门级原语和UDP结构建模描述方式
2.2 多路选择器不同形式的Verilog描述
2.2.1 4选1多路选择器及其顺序语句表述方式
2.2.2 4选1多路选择器及其并行语句表述方式
2.2.3 4选1多路选择器及其条件操作语句表述方式
2.2.4 4选1多路选择器及其条件语句表述方式
2.2.5 4选1多路选择器及其利用UDP元件的结构表述方式
2.3 Verilog加法器设计
2.3.1 全加器设计及例化语句应用
2.3.2 8位加法器设计及算术操作符应用
2.3.3 BCD码加法器设计
2.4 组合逻辑乘法器设计
2.4.1 参数定义关键词parameter和localparam
2.4.2 整数型寄存器类型定义
2.4.3 for语句用法
2.4.4 移位操作符应用法
2.4.5 两则乘法器设计示例
2.4.6 repeat语句用法
2.4.7 while语句用法
2.4.8 Verilog循环语句的特点
2.4.9 parameter的参数传递功能
习题
第3章 Quartus Ⅱ应用向导
3.1 Quartus Ⅱ应用一般流程
3.1.1 输入设计程序
3.1.2 创建本项目设计工程
3.1.3 设置约束项目
3.1.4 全程编译与逻辑综合
3.1.5 测试设计项目
3.1.6 RTL图观察器应用
3.2 硬件功能验证及FPGA开发
3.2.1 引脚锁定
3.2.2 编译文件下载
3.2.3 JTAG间接编程模式
3.2.4 USB-Blaster编程配置器件使用方法
3.3 电路原理图设计流程
3.4 利用属性表述实现引脚锁定
3.5 keep属性应用
3.6 SignalProbe使用方法
3.7 宏模块逻辑功能查询
习题
EDA实验
3-1 多路选择器设计实验
3-2 8位加法器设计实验
3-3 十六进制7段数码显示译码器设计
第4章 时序电路Verilog设计
4.1 基本时序元件的Verilog表述
4.1.1 基本D触发器单元及其Verilog表述
4.1.2 用UDP表述D触发器
4.1.3 含异步复位和时钟使能的D触发器及其Verilog表述
4.1.4 含同步复位控制逻辑的D触发器及其Verilog表述
4.1.5 基本锁存器及其Verilog表述
4.1.6 含清0控制的锁存器及其Verilog表述
4.1.7 异步时序电路的Verilog表述特点
4.1.8 时钟过程表述的特点和规律
4.2 二进制计数器及其Verilog表述
4.2.1 简单加法计数器及其Verilog表述
4.2.2 实用加法计数器设计
4.3 移位寄存器的Verilog表述与设计
4.3.1 含同步预置功能的移位寄存器设计
4.3.2 模式可控的移位寄存器设计
4.3.3 使用移位操作符设计移位寄存器
4.4 时序电路硬件设计与仿真示例
4.5 SignalTap Ⅱ的使用方法
习题
EDA实验
4-1 数字计数器设计实验
4-2 十六进制7段数码显示译码器设计
4-3 数码扫描显示电路设计
4-4 模可控计数器设计
4-5 移位寄存器设计
4-6 串行静态显示控制电路设计
4-7 应用宏模块设计频率计
第5章 逻辑宏功能模块的应用
5.1 计数器宏模块调用
5.1.1 计数器模块文本的调用
5.1.2 计数器模块程序与参数传递语句
5.1.3 对计数器进行仿真测试
5.2 利用属性设置控制乘法器的构建
5.3 RAM宏模块的使用方法
5.3.1 存储器初始化文件
5.3.2 RAM宏模块的设置和调用
5.3.3 仿真测试RAM宏模块
5.3.4 存储器的Verilog代码描述及初始化文件调用
5.3.5 存储器设计的结构控制
5.4 LPM存储器在系统读写方法
5.5 嵌入式锁相环使用方法
5.6 信号在系统测试与控制编辑器用法
习题
EDA实验与创新实践
5-1 查表式硬件运算器设计
5-2 正弦信号发生器设计
5-3 DDS正弦信号发生器设计
5-4 移相信号发生器设计
第6章 EDA技术深入
6.1 过程中的两类赋值语句
6.1.1 未指定延时的阻塞式赋值语句
6.1.2 指定了延时的阻塞式赋值
6.1.3 未指定延时的非阻塞式赋值
6.1.4 指定了延时的非阻塞式赋值
6.1.5 阻塞与非阻塞式赋值特点的深入讨论
6.1.6 不同赋值方式的信号赋初值导致不同综合结果
6.2 过程语句使用深入探讨
6.2.1 过程语句应用总结
6.2.2 深入认识不完整条件语句与时序电路的关系
6.3 更完整地认识if语句
6.3.1 if语句的一般表述形式
6.3.2 关注if语句中的条件指示
6.4 三态与双向端口设计
6.4.1 三态控制电路设计
6.4.2 双向端口设计
6.4.3 三态总线控制电路设计
6.5 系统设计优化
6.5.1 资源优化
6.5.2 速度优化
习题
EDA实验与创新实践
6-1 硬件消抖动电路设计
6-2 4×4阵列键盘键信号检测电路设计
6-3 直流电机综合测控系统设计
6-4 VGA彩条信号显示控制电路设计
第7章 有限状态机设计技术
7.1 状态机的一般形式
7.1.1 状态机的基本结构
7.1.2 初始控制与表述
7.2 Moore型有限状态机
7.2.1 实用状态机设计示例
7.2.2 序列检测状态机设计
7.3 Mealy型状态机设计
7.4 不同编码类型状态机
7.4.1 直接输出型编码
7.4.2 宏定义语句在状态编码定义中的用法
7.4.3 宏定义命令语句
7.4.4 顺序编码型状态机编码
7.4.5 一位热码编码
7.4.6 状态编码设置
7.5 **状态机设计
习题
EDA实验与创新实践
7-1 序列检测器设计
7-2 ADC采样控制电路设计
7-3 数据采集逻辑控制模块设计
7-4 五功能智能逻辑笔设计
7-5 VGA简单图像显示控制模块设计
第8章 16位实用CPU创新设计
8.1 KX9016的结构与特色
8.2 KX9016基本硬件系统设计
8.2.1 单步节拍发生模块
8.2.2 算术逻辑单元
8.2.3 比较器COMP
8.2.4 基本寄存器与寄存器阵列组
8.2.5 移位器
8.2.6 程序与数据存储器
8.3 KX9016v1指令系统设计
8.3.1 指令格式
8.3.2 指令操作码
8.3.3 软件设计实例
8.3.4 KX9016 v1控制器设计
8.3.5 指令设计实例详解
8.4 KX9016的时序仿真与硬件测试
8.4.1 时序仿真与指令执行波形分析
8.4.2 CPU工作情况的硬件测试
8.5 KX9016应用程序设计实例和系统优化
8.5.1 乘法算法及其硬件实现
8.5.2 除法算法及其硬件实现
8.5.3 KX9016v1的硬件系统优化
习题
EDA

《普通高等教育“十二五”规划教材·工程创新型电子信息类精品教材:EDA技术及其创新实践(Verilog HDL版)》可作为高等院校电子工程、通信、工业自动化、计算机应用技术、电子对抗、仪器仪表、数字信号或图像处理等学科的本科生或研究生的电子设计、EDA技术和VerilogHDL硬件描述语言课程的教材及实验指导书,同时也可作为相关专业技术人员的自学参考书。《普通高等教育“十二五”规划教材·工程创新型电子信息类精品教材:EDA技术及其创新实践(Verilog HDL版)》提供免费课堂教学与实验课件以及硬件演示程序。